01 gennaio 07, 21:15 | #11 (permalink) Top |
User Data registr.: 21-01-2004 Residenza: Milano
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Guardalo così e dimmi se ti va bene... Michele P.S. Per visualizzarlo correttamente salvalo su disco e aprilo con un programma di visualizzazione.
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03 gennaio 07, 18:51 | #16 (permalink) Top | |
User Data registr.: 21-01-2004 Residenza: Milano
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Non mi sembra particolarmente complicato ricopiare lo schema che ti ho preparato; se non vuoi vedere le uscite intermedie [che sono solo di punti per la visualizzazione dei segnali] non le metti e non ti compariranno nemmeno nella finestra di simulazione... Michele
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03 gennaio 07, 18:57 | #17 (permalink) Top |
Sospeso Data registr.: 28-12-2006
Messaggi: 23
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sisi, infatti quello ora non è piu il problema. il problema è che hai usato flip flop delay invece devo usare i JK. poi vorrei chiederti una cosa, tu oltre a dare la sequenza di input al data sequencer cos'altro hai dato? cioè le stringhe da riconoscere come fai a darle ai flip flop? |
03 gennaio 07, 19:21 | #18 (permalink) Top | |
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Michele
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03 gennaio 07, 19:43 | #20 (permalink) Top | |
User Data registr.: 21-01-2004 Residenza: Milano
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| Citazione:
Tutti i clock vanno collegati insieme al generatore e tutti i clr insieme al positivo. L'and e lo xor vanno collegati agli stessi punti. Michele
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